|
|
Perspektivní obvodové struktury pro modulární neuronové sítě
Bohrn, Marek ; Ďuračková, Daniela (oponent) ; Husák, Miroslav (oponent) ; Fujcik, Lukáš (vedoucí práce)
Předkládaná práce se zabývá návrhem nové obvodové struktury pro implementace dopředných neuronových sítí. Navržená struktura využívá nekonvenční uspořádání sběrnic pro propojení dílčích bloků. Přínos navržené struktury spočívá v optimalizaci vytížení výpočetních bloků a zvýšení efektivity přenosu dat mezi nimi. Navržená struktura je flexibilní a vhodná pro implementace širokého spektra topologií dopředných neuronových sítí.
|
|
|
Implementace výpočtu FFT v obvodech FPGA a ASIC
Dvořák, Vojtěch ; Bohrn, Marek (oponent) ; Fujcik, Lukáš (vedoucí práce)
Cílem diplomové práce je navrhnout implementaci algoritmu rychlé Fourierovi transformace, kterou lze použít v obvodech FPGA nebo ASIC. Implementace bude modelována v prostředí Matlab a následně bude použit tento návrh jako referenční model pro popis implementace algoritmu rychlé Fourierovy transformace v jazyce VHDL. Pro ověření správnosti návrhu bude vytvořeno verifikační prostředí a provedena verifikace. V poslední části práce bude navržen program, který bude generovat zdrojové kódy pro různé parametry modulu provádějícího rychlou Fourierovu transformaci.
|
|
|
Behaviorální syntéza digitálních obvodů
Jendrušák, Ján ; Fujcik, Lukáš (oponent) ; Dvořák, Vojtěch (vedoucí práce)
Táto práca sa zaoberá praktickým otestovaním behaviorálnej syntézy ako spôsobu návrhu digitálnych obvodov a jej momentálnym progresom pri tvorbe RTL popisov. V úvode práce sú popísané hlavné úlohy behaviorálnej syntézy spolu s knižnicou tried jazyka C++ nazvanou SystemC, ktorá implementuje hardvérové konštrukcie, dátové typy s definovateľnou dátovou šírkou a vie pracovať s časom. Ďalej sa práca zameriava na diskrétnu Fourierovu transformáciu a jej modifikáciu pre efektívnejší výpočet – rýchlu Fourierovu transformáciu. V praktickej časti práce je navrhnutý referenčný model algoritmu FFT, ktorý je ďalej vhodne upravený a prevedený nástrojom pre behaviorálnu syntézu Stratus High-Level Synthesis do viacerých hardvérových architektúr.
|
|
| |
|
|
Návrh a realizace matematických operací v obvodech FPGA
Soukup, Luděk ; Šteffan, Pavel (oponent) ; Fujcik, Lukáš (vedoucí práce)
Tato bakalářská práce se zabývá problematikou realizace matematických operací v prostředí digitálních obvodů architektur FPGA a ASIC. Pozornost je věnována algoritmům pro sčítání, odečítání, násobení a dělení, dále potom algoritmům pro výpočet goniometrických funkcí. Vybrané algoritmy jsou popsány v jazyce VHDL, syntetizovány a porovnány na základě získaných informací o výpočetním zpoždění a ploše, která je nutná pro jejich realizaci. V závěrečné části práce je diskutována možnost implementace těchto algoritmů.
|
|
|
Implementace jádra 8-bitového mikrokontroléru do FPGA a ASIC
Walletzký, Ondřej ; Dvořák, Vojtěch (oponent) ; Bohrn, Marek (vedoucí práce)
Tato práce se zabývá návrhem jádra 8-bitového mikroprocesoru kompatibilního s jedním z 8-bitových mikrokontrolérů PIC společnosti Microchip. Teoretická část práce zkoumá jednotlivé architektury 8-bitových mikrokontrolérů PIC a popisuje architekturu vybraného mikrokontroléru a funkci jeho dílčích bloků. V praktické části je proveden návrh a realizace jádra kompatibilního z hlediska provádění instrukcí, toku dat uvnitř mikrokontroléru a funkce jeho dílčích bloků, to vše pro dosažení co možná nejlepší přenositelnosti programu psaného pro vzorový mikrokontrolér. Poslední část práce popisuje metodu implementace realizovaného jádra do obvodu FPGA a zmiňuje případné rozdíly návrhu pro implementaci do obvodu ASIC. Také řeší otázku programování jádra, jeho testování a verifikaci.
|
|
|
Modelling and simulation of analog circuits in FPGA
Kotulič, Dominik ; Fujcik, Lukáš (oponent) ; Dvořák, Vojtěch (vedoucí práce)
Bachelor thesis is focused on seeking a suitable calculation algorithm of an exponential function which could be suitably implemented in ASIC and FPGA circuits. The first part of the thesis is aimed at brief clarifying of the issue of transients in accumulation circuits and their modelling in the program PSpice. The second part deals with seeking ways of model proposals of the exponential function appropriate for the implementation in ASIC and FPGA circuits. Subsequently, in the final part of the thesis we designed and tested two calculation algorithms of the model of the exponential function that are implemented for floating point numbers.
|
|
|
Network traffic and cyber attacks generator on the FPGA platform
Heriban, Radoslav ; Smékal, David (oponent) ; Lieskovan, Tomáš (vedoucí práce)
This thesis is focused on the most common and every day more popular threat of DoS attacks. All networks are vulnerable to this kind of attack, and with growing popularity and intensity it shouldn't be underestimated. The goal of this thesis was creating hardware accelerated generator of DoS traffic intented for testing our own networks and identifying the risks. FPGA technology is used for this task, since it has proven to be more effective way of prototyping hardware design then developing ASIC. The language used to describe desired design behavior is VHDL. Designed ICMP and UDP flood attacks are simulated in Xilinx ISE development environment. Description of problems faced before any result was reached is also included for future researchers interested in similar projects.
|
|
|
USB communication protocol analysis
Zošiak, Dušan ; Fujcik, Lukáš (oponent) ; Šteffan, Pavel (vedoucí práce)
Tato práce je zaměřena na zpracování a analýzu USB komunikačního protokolu a implementace jeho jednotlivých částí do FPGA obvodu s využitím programovacího jazyka VHDL. Ve finální podobě by měla práce představovat souhrnný a ucelený dokument popisující principy USB rozhraní a jeho komunikace doplněných praktickým návrhem v jazyce VHDL, který by byl schopen převést data do USB.
|
|
|
Testování integrovaných analogových násobiček
Stolařová, Hana ; Dvořák, Radek (oponent) ; Šotner, Roman (vedoucí práce)
Tato diplomová práce se zabývá návrhem testovacího přípravku (dále jen testeru) pro základní ověření parametrů i aplikací s analogovými násobičkami vyrobenými v procesu TSMC 0.18 m 1.8 V, který je následně použitý při experimentálním ověřování. Výstup ověřování zahrnuje kmitočtové charakteristiky, stejnosměrné charakteristiky, zkreslení, offset a charakteristiky vstupní a výstupní impedance. Součástí jsou také návrhy možných aplikací s analogovými násobičkami (generátor trojúhelníkového a obdélníkového průběhu, aktivní filtr 2. řádu, integrátor, atd.).
|
host ::
RSS.